引 言

PCIe是一個在很多領(lǐng)域中都有著廣泛且重要應(yīng)用的接口，經(jīng)過十幾年的發(fā)展，PCIe接口已經(jīng)從1.0發(fā)展到現(xiàn)在的3.0，4.0也已即將開始應(yīng)用。PCIe技術(shù)的物理層基于串行SerDes技術(shù)，因此用極少的物理連線就可以實現(xiàn)高速的數(shù)據(jù)傳輸。筆者在前段時間碰上了兩個PCIe接口失效的問題，第一個經(jīng)過分析是PCIe的ESD防護沒有做好導(dǎo)致通訊中斷，第二個是電源負載過大導(dǎo)致PCIe供電異常，FPGA PCIe IPCORE邏輯時鐘失鎖。現(xiàn)把這兩個問題的定位和解決過程與讀者一同分享。

 1.系統(tǒng)概述及問題描述

現(xiàn)簡略的介紹該系統(tǒng)，其簡略框圖如下：

該系統(tǒng)由兩個模塊組成，前端模塊可插拔，在插入后會傳輸信號給FPGA，信號經(jīng)過前端接收，A/D采樣后進入FPGA做信號處理，然后FPGA把處理過的信號通過PCIe接口傳送給工控機進行后處理及顯示。工控機也會通過PCIe接口控制FPGA的工作狀態(tài)。前端的模塊是可插拔的。

第一個問題是該機器在做測試時，發(fā)現(xiàn)在換模塊時會偶發(fā)的出現(xiàn)工控機與FPGA的通訊異常的現(xiàn)象，該現(xiàn)象出現(xiàn)的頻率很低，測試組的同事反饋在做測試時經(jīng)常會有換模塊的操作，但該現(xiàn)象基本上幾天才出現(xiàn)一次，雖然該現(xiàn)象概率低，但是問題影響甚為重大，必須攻破。

第二個問題則是系統(tǒng)不接交流電而使用電池運行在某種模式下，在達到10%低電量時，會必發(fā)的出現(xiàn)PCIe通訊異常。

 2.第一個問題定位及解決過程

該問題的定位開始是沒有頭緒的，因為問題出現(xiàn)后，PCIe的通訊已經(jīng)中斷，此時想通過工控機去讀FPGA的調(diào)試相關(guān)的寄存器已經(jīng)沒有用，即此時讀上來的值都是無效的。但是還是得先逐步的排除問題。

第一步：是否是軟件的問題

通過閱讀問題發(fā)生時的軟件日志，發(fā)現(xiàn)在問題發(fā)生時，軟件沒有收到中斷請求，這說明在插拔模塊的過程中，PCIe通訊已經(jīng)失效，模塊插入/拔出的中斷已經(jīng)無法發(fā)出(在模塊插入或者拔出的過程FPGA會檢測，如果發(fā)生該事件FPGA會通過PCIe發(fā)出中斷給工控機)。且在問題發(fā)生時軟件日志的記錄上軟件沒有異常之處，因此排除是軟件的問題。 

第二步：是否是FPGA邏輯的問題

通過在FPGA插入在線邏輯分析儀，把PCIe的運轉(zhuǎn)狀態(tài)機LTSSM加入到在線邏輯分析儀，在發(fā)生此問題時觸發(fā)觀測LTSSM狀態(tài)機。在測試時，復(fù)現(xiàn)該問題后發(fā)現(xiàn)LTSSM有重新回到復(fù)位狀態(tài)的動作，因此懷疑此時可能是電源或者是PCIe接口復(fù)位信號的問題，因為在正常情況下，如果系統(tǒng)復(fù)位信號沒有動作，且上位機沒有重新發(fā)送PCIe鏈路訓(xùn)練命令的話，LTSSM狀態(tài)機是不會被復(fù)位的。因此該線索把該問題的原因?qū)虻綇?fù)位信號或電源上。

第三步：監(jiān)測PCIe接口的復(fù)位信號

PCIe接口的電路如下圖所示：

由上圖可以看到，PCIe接口由數(shù)據(jù)接收差分管腳PCIE_RX_P，PCIE_RX_N，數(shù)據(jù)發(fā)送差分管腳PCIE_TX_P，PCIE_TX_N，以及SMBUS(SMBCLK, SMBDAT)，JTAG管腳，參考時鐘PCIE_REFCLK_P，PCIE_REFCLK_N以及復(fù)位管腳PCIE_PERST_N組成。其中JTAG管腳和SMBUS可以不連，參考時鐘也可以選擇用本地時鐘或者選用接插件過來的PCIE_REFCLK_P，PCIE_REFCLK_N。前面提到，由于重點懷疑復(fù)位信號有所動作，因此對該復(fù)位信號用示波器進行監(jiān)測。在若干次實驗以后，發(fā)現(xiàn)在某次插入模塊后失效時，捕捉到了PCIE復(fù)位信號PCIE_PERST_N有一個持續(xù)時間約為2.3個us的低電平脈沖，正是該脈沖信號讓FPGA的PCIE IPCORE復(fù)位，導(dǎo)致PCIE通訊中斷的原因。該脈沖信號如下圖所示：

該干擾脈沖從何處而來？經(jīng)過實驗發(fā)現(xiàn)是靜電導(dǎo)入。我們在插拔模塊時，由于模塊本身外殼有部分金屬，因此靜電從外殼金屬進來后經(jīng)過某些路徑耦合到PCIe復(fù)位線上，引發(fā)了該問題。

問題解決思路：找到問題來源點，解決方法就多種多樣了。在此筆者推薦三種方法一起用：1. 對PCIE_PERST_N復(fù)位信號加濾波；2. 做好整機/模塊的ESD保護；3. FPGA對PCIE_PERST_N信號做判斷后再引入FPGA的PCIe IPCORE復(fù)位端，即對PCIE_PERST_N信號做低脈沖時間計數(shù)，大于規(guī)定的ms級低電平才判斷為復(fù)位，否則則判斷為干擾信號，FPGA控制邏輯不去復(fù)位PCIE IPCORE。

3.第二個問題定位及解決過程

該問題的定位比第一個問題定位簡單。因為該問題是在帶電池低電量時必發(fā)，在插上交流電時則沒有該現(xiàn)象，因此可以排除軟件和FPGA邏輯問題，因此把問題聚焦在電源上。通過示波器實地測試，發(fā)現(xiàn)在電池低電量且工作于該模式下，電流有突然增大的現(xiàn)象，導(dǎo)致此時電壓跌落，引發(fā)FPGA邏輯時鐘失鎖，由于FPGA邏輯的設(shè)計是使用邏輯系統(tǒng)時鐘鎖定信號作為PCIe IPCORE部分邏輯的復(fù)位信號，因此此時會導(dǎo)致FPGA的PCIe IPCORE被復(fù)位，進而產(chǎn)生PCIe通訊失效的現(xiàn)象?，F(xiàn)在來分析一下整個過程，該時刻波形記錄如下圖所示：

如上圖所示，黃色的波形為系統(tǒng)電流波形，使用電流探頭測量，綠色和青色波形為模塊某部分調(diào)壓波形，非FPGA PCIe供電電壓，在此處可以認為跟筆者的分析無關(guān)。比較遺憾的是，這個截圖中沒有記錄下FPGA的供電電壓，有記錄的圖筆者沒有找到。但是該圖可以很明確的分析此時系統(tǒng)電流變化的過程：在某種工作模式下，電流突然急劇上升，此時會造成FPGA供電電壓發(fā)生變化，進而導(dǎo)致FPGA邏輯時鐘失鎖，進而造成FPGA邏輯復(fù)位，由于此時FPGA邏輯處于復(fù)位狀態(tài)，寄存器不再翻轉(zhuǎn)，因而系統(tǒng)供電電流突然急劇下降，此時可以對應(yīng)到上圖的電流急劇下跌，由于電流下跌，負載減輕導(dǎo)致FPGA工作電壓回復(fù)正常，時鐘重新鎖定，FPGA邏輯復(fù)位完成，重新工作，因此電流又重新回復(fù)到比之前模式切換時的功耗略少的狀態(tài)。整個過程是一個鏈?zhǔn)椒磻?yīng)，非常清晰的被記錄在示波器上。

問題解決思路：改善電源模塊供電設(shè)計，增加裕量。

4.總 結(jié)

對于PCIe接口的穩(wěn)定性設(shè)計來說，電源和時鐘是關(guān)鍵，在保證了電源和時鐘的穩(wěn)定性以后，還需要注意對關(guān)鍵敏感信號的保護，在有外部接插，觸碰動作介入系統(tǒng)的情況下，注意對PCIe接口的敏感信號，如復(fù)位信號的保護是非常有必要的。

 鼎陽硬件智庫專家介紹 

樊繼明,硬件設(shè)計與測試從業(yè)6年,專長ASIC/FPGA邏輯設(shè)計，高速接口(LVDS, 高速SerDes)邏輯設(shè)計與驗證,2009年畢業(yè)于華南理工大學(xué)，工學(xué)碩士。曾在通訊行業(yè)從事過3年的ASIC設(shè)計，主要涉及到光傳送網(wǎng)100G OTN DSP物理層芯片邏輯設(shè)計，現(xiàn)在某醫(yī)療設(shè)備行業(yè)從事FPGA邏輯設(shè)計，主要聚焦于高速接口以及數(shù)字波束合成方面的設(shè)計。

關(guān)于鼎陽

鼎陽科技（SIGLENT）是一家專注于通用電子測試測量儀器及相關(guān)解決方案的公司。

從2005推出第一款數(shù)字示波器產(chǎn)品至今，10年來鼎陽科技一直是全球發(fā)展速度最快的數(shù)字示波器制造商。歷經(jīng)多年發(fā)展，鼎陽產(chǎn)品已擴展到數(shù)字示波器、手持示波表、函數(shù)/任意波形發(fā)生器、頻譜分析儀、臺式萬用表、直流電源等通用測試測量儀器產(chǎn)品。2007年，鼎陽與高端示波器領(lǐng)導(dǎo)者美國力科建立了全球戰(zhàn)略合作伙伴關(guān)系。2011年，鼎陽發(fā)展成為中國銷量領(lǐng)先的數(shù)字示波器制造商。2014年，鼎陽發(fā)布了中國首款智能示波器SDS3000系列，引領(lǐng)“人手一臺”型實驗室使用示波器由功能示波器向智能示波器過渡的趨勢。目前，鼎陽已經(jīng)在美國克利夫蘭和德國漢堡成立分公司，產(chǎn)品遠銷全球70多個國家，SIGLENT正逐步成為全球知名的測試測量儀器品牌。

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